胡成龙

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澜至半导体 - 高级验证工程师(IP/SOC验证) @
胡成龙's Location
Minhang District, Shanghai, China, China
About 胡成龙

An good fighter who can face any challege peacefully and smoothlyAs an IC verification engineer, already do several fullchip projects from the beginning to the end.I am familiar with the software and hardware design process and debugging methods required for chip verification include IP/SOC/FPGA, and develop module-level and SOC-level EDA verification and overall FPGA prototype verification based on various IES or VCS, xilinx and Altera verification platform systems to implement relevant SOC high-speed interface algorithm control IP (some special algorithm IP )or data stream type IP(like SDIO/USB/CPRI) and ARM SOC system with UVM, systemverilog, C language , verilog and python etc. Proficient in Linux workstations and scripting languages such as SV, C and TCL\Pathon to realize verification testcases and build UVM verification environment, as well as the entire verification method and strategy for algorithm control class or data flow type IP and SOC verification.include Implementation of verification coverage model building, analysis and improvement. ensure end-to-end verification as few remaining problems as possible. Proficient in using the underlying software, EDA tools and related languages, such as C language, Linux \ IES \ NC-SIM \ UVM \ SystemVerilog \ TCL \ Pathon, makefile, Quartus II, Xilinx ISE, ModelSim, VIVADO, synplify, etc. Participate in writing project-related delivery documents for many times, and have good document writing abilityHave good command of English(CET6 508) .Strong independent analysis ability of troubleshooting and problem solving skills.Can bears hardships and take in hard works. Have good team collaboration.Good at self-regulation.作为一名集成电路验证工程师,成功参与完成多个全流程芯片项目和FPGA项目。熟悉芯片验证所需的软硬件设计流程和调试方法,包括IP/SOC/FPGA,基于IES或VCS进行各种模块级和SOC级EDA验证和整体FPGA原型验证,用到UVM、systemverilog、C语言、verilog和TCL/python等语言实现相关SOC中高速接口算法控制类IP(一些特殊算法IP)或数据流类型IP(如SDIO/USB/CPRI)和部分ARM SOC系统级的验证。熟练掌握Linux/UVM/Vivado/IES/Verdi/Simvision等工具,了解如何搭建UVM验证环境和基于测试点分析,设计验证测试用例,实现算法控制类或数据流类型IP级和验证整体互联互通的SOC级的完整验证方法和策略。包括验证覆盖率模型的建立收集、分析和改进。确保端到端验证的完善和尽可能的减少遗留问题。熟练使用各种验证相关底层软件、EDA工具和相关语言。多次参与项目相关交付文件的编写,具有良好的文件编写能力。英语水平良好(CET6 508)。有较强的独立分析能力和解决问题的能力。能吃苦耐劳。具有良好的团队协作能力。善于自我调节。

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澜至半导体 - 高级验证工程师(IP/SOC验证)
胡成龙 Work Experience Details
  • 澜至半导体
    高级验证工程师
    澜至半导体 Dec 2019 - Present
    中国 上海 徐汇区
    负责多媒体芯片full chip的相关IP和部分ARM… Show more 负责多媒体芯片full chip的相关IP和部分ARM SOC基于UVM的仿真验证,梳理优化整个验证流程并完成验证收敛>从spec讨论阶段到提炼测试点,编写测试用例,开发验证环境到验证报告评审阶段全流程完成EMMC/SD/SDIO/AMBA等几种通用高低速接口的基于VIP验证并导入SOC环境完成基于C的互联互通验证。另外完成自研的高安算法类KeyTable、AVS电源管理类,demod调制解调,编解码等几个IP的BT级验证并收敛到FPGA阶段没有发现bug,另外参与整个SOC中互联通信、功能性能和低功耗验证、时钟复位寄存器、pinmux功能等formal验证和多个相关自动化脚本开发增加研发效率。之前参与完成一款多媒体机顶盒SOC芯片的全流程验证,已经上市>根据spec和协议以及和算法开发人员沟通,基于UVM、systemverilog和C语言等开发IP模块和整个SOC的UVM仿真验证平台和相关为了提升验证效率的基于python的自动化验证脚本,根据提炼的测试点设计和执行各种随机用例、定向用例和SVA等来覆盖所有测试点,并开发功能覆盖率模型并收集代码功能断言等覆盖率,确保各覆盖率达标,仿真过程中通过波形、工具等方法debug仿真过程中各种问题,高效定位问题并协同设计解决问题,实现尽快收敛并完成验证报告>基于python等脚本语言开发和优化整体验证FLOW和开发验证工具,提高整体验证效率和确保验证准确度>基于veloce的EMU平台进行一些类似soc dft的加速器仿真 Show less
  • 华为
    芯片验证工程师(Uvm&Fpga)
    华为 Dec 2016 - Sep 2019
    主要做5G芯片算法控制类和数据流类型IP的UVM验证,从根据需求的前期分析测试点到后仿全流程参与,具备端到端的验证能力,熟练掌握systemverilog的基本语法并搭建验证环境,熟练掌握UVM中各模块和组件的实现和不同验证目标用例的实现。实现定向、随机、断言等用例来确保基本功能和各种拐点和异常点验证,确保覆盖率,熟练掌握各种覆盖率模型的搭建和提升。并同时通过分析Verdi图形和用脚本语言实现各节点数据对比来保证验证效果,确保不遗漏问题。负责的模块每万行代码提代码单20个左右、需求实现以及文档单十个左右,具备有效和算法人员,设计人员以及后端沟通并深入挖掘bug的能力,具备根据不同应用场景深挖设计代码实现正确度和实现效率的能力,并更加理解从小站到基带的整个5G芯片的架构负责基带芯片SOC某高速接口的前端模块的基于UVM的IP验证和FPGA原型验证和以及样片验证,分析物理层和数据链路层协议和高速接口特性功能验证点,设计输出验证用例并设计实现验证的总体验证平台,通过verilog、Systemverilog、C语言和TCL,python等脚本语言用华为自有工具和UVM等来构造验证平台… Show more 主要做5G芯片算法控制类和数据流类型IP的UVM验证,从根据需求的前期分析测试点到后仿全流程参与,具备端到端的验证能力,熟练掌握systemverilog的基本语法并搭建验证环境,熟练掌握UVM中各模块和组件的实现和不同验证目标用例的实现。实现定向、随机、断言等用例来确保基本功能和各种拐点和异常点验证,确保覆盖率,熟练掌握各种覆盖率模型的搭建和提升。并同时通过分析Verdi图形和用脚本语言实现各节点数据对比来保证验证效果,确保不遗漏问题。负责的模块每万行代码提代码单20个左右、需求实现以及文档单十个左右,具备有效和算法人员,设计人员以及后端沟通并深入挖掘bug的能力,具备根据不同应用场景深挖设计代码实现正确度和实现效率的能力,并更加理解从小站到基带的整个5G芯片的架构负责基带芯片SOC某高速接口的前端模块的基于UVM的IP验证和FPGA原型验证和以及样片验证,分析物理层和数据链路层协议和高速接口特性功能验证点,设计输出验证用例并设计实现验证的总体验证平台,通过verilog、Systemverilog、C语言和TCL,python等脚本语言用华为自有工具和UVM等来构造验证平台、参考模型RM、数据传输工具和数据对比系统scoreboard,并进行流片前的无业务芯片FPGA原型验证和UVM的互联系统验证,设计和构造基带芯片中的不同业务验证组件,比如5G/LTE/UMTS/GSM对应的高速接口CPRI/XGE等。实现针对各种业务模型和环境的验证用例数百个包括随机和断言等,实现验证覆盖率覆盖率分析和完善确保端到端验证,每款芯片发现数十个芯片代码问题和数十个芯片功能描述和实现方式问题。实现和搭建相关验证平台和比对参考模型,并完成芯片片内和对端构造数据、打通通路,互联收发数据比对验证。验证目标针对高速接口,在最近的三款6185、6186、86L最新5g基带芯片中已经完成输出执行500多个用例并定位所有软硬件问题,搭建高速接口CPRI和XGE和以及接口控制IOE的验证平台和参考模型,以及相关构造数据和控制比对数据工具,并挖掘和实现有效定位手段去发现芯片架构、代码以及输出文档问题数个,最终整合梳理输出总体验证报告。已经全流程完成3款基带芯片的验证工作 Show less
  • Montage Technology, Inc
    Ic System Verification
    Montage Technology, Inc Jun 2015 - Dec 2016
    Shanghai
    主要负责开发维护验证平台并进行前端算法和流片后验证,用CADENCE等软件设计基于V7… Show more 主要负责开发维护验证平台并进行前端算法和流片后验证,用CADENCE等软件设计基于V7 2000t、spantan6,V6等FPGA验证系统原理图,检查PCB,开发和维护IC验证所需spantan和virtex的FPGA开发板以及相关通信板卡。用VMM/UVM等EDA方法验证部分demod算法类IP,设计基于这些自己开发的验证平台开发芯片数据流验证所需的SV和verilog程序,用到ISE\VIVADO\SYNPLIFY\VC等EDA软件和TCL等脚本语言,解决芯片验证中的时序和软硬件问题,针对接口协议和现有IP进行FPGA中用到的包括I2C,SDIO和LVDS,DDR、PCIE等高低速接口的二次开发,并进行芯片SCAN、数据流输入输出等验证,模拟和数字信号采集,matlab分析等。以便在前端验证相关算法,提出问题发现BUG和在流片后进行快速验证,主要负责多款机顶盒芯片中tuner和demod模块,以及wifi芯片验证针对ADC/DAC模块数据流进行数字和模拟部分FPGA系统验证,并用C语言开发PC端的驱动程序和控制程序实现数据流的控制输出分析数据,用matlab进行验证数据分析验证功能和性能前端算法验证通过3个项目,协助找出数十个问题进行修正,后端协助AE部门进行了3款芯片的流片后验证,开发了用来验证WIFI芯片的基于FPGA的ADC/DAC 数据流存储和输出开发板和用于机顶盒的双tuner+demod+SOC芯片的验证系统,并用C语言开发了相关算法验证所需芯片驱动程序 Show less
  • 中国电子科技集团公司第三十二研究所
    Fpga系统工程师
    中国电子科技集团公司第三十二研究所 Jul 2013 - Jun 2015
    RD,主要研究FPGA系统的硬件设计和实现接口协议转换和相关驱动的功能代码实现

胡成龙 Education Details

Frequently Asked Questions about 胡成龙

What company does 胡成龙 work for?

胡成龙 works for 澜至半导体

What is 胡成龙's role at the current company?

胡成龙's current role is 澜至半导体 - 高级验证工程师(IP/SOC验证).

What schools did 胡成龙 attend?

胡成龙 attended 中国电子科学院, 东北大学.

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